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Virtual Pin

2009-11-6 21:51 3570 0 2 分类: FPGA/CPLD

Virtual Pin


记得之前在FPGA/CPLD助学小组里有网友提出过在Quartus II编译完成后的Flow Summary里出现的Virtual Pin,如图1所示。那它到底是怎么回事呢?<?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" />


<?xml:namespace prefix = v ns = "urn:schemas-microsoft-com:vml" />


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1 Flow Summary


    Virtual Pin即虚拟管脚。在实际应用中,通常对于一个大的设计工程,Team Leader会将整个工程划分几个模块分别交给数位工程师完成。而对于一个固定的工程,它所使用的总的I/O数量是预先按需求定义好的,也就是说最终要使用的FPGA器件的I/O数量是一定要满足要求的。但是,在划分的几个模块中,它们之间也许不仅有需要分配给实际I/O的信号,更多的是与内部其他模块间相互通信的信号。这些信号在独立的模块中,独立的设计编译中,他们总的IO数量很可能超出所选用FPGA器件的I/O数量,因此导致编译报错。另外,有时我们也会对一些IP核做测试,而这个测试只是简单的把这个IP核的所有接口都引出来,有时我们所需要使用的器件的I/O数量不够用,也会导致编译报错。怎么办?


    Quartus IIVirtual Pin就能解决这些问题。想必说到这里,大伙也明白了这个Virtual Pin做什么用了。对,它就是要把工程里定义的I/O不作为需要连接到器件I/O上的I/O


    那么这个功能如何使用呢?很简单,图1Flow Summary里对应的工程现在使用了可用104I/O55个,我们添加100个名为test_pinoutput I/O,直接编译肯定报错。在Quartus IITcl Console中输入以下tcl命令:


set_instance_assignment –name VIRTUAL_PIN ON –to test_pin


    然后重新编译,得到如图2所示的Flow Summary。使用了100virtual pins。正是前面所添加的test_pin



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2 添加virtual pins后的Flow Summary


    如果需要取消这个virtual pins设置,那么输入tcl命令:


set_instance_assignment –name VIRTUAL_PIN OFF –to test_pin


    这个语法是固定的,对于不同的需要设置virtual pins的管脚,只要替代前面的test_pin名字即可。


 


 

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文章评论 2条评论)

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295179192_833843331 2015-9-17 23:51

谢谢博主的分享

billzhu_345737527 2015-5-21 21:56

博主能再发给我一个例程吗?或者重新更新一下分享!2483549986@qq.com 万分感谢!

mzl127127_270116653 2014-10-28 16:30

您好 我现在想用光纤和FPGA实现通信 然后通过光纤把数据传到上位机上 可以通过光纤转网口实现吗?

ilove314_323192455 2011-6-28 17:04

认真看看你的工程代码,是否都被“综合”掉了

fpga_play_467039323 2011-6-28 15:08

对一个小的module做测试,引脚设为虚拟引脚。但是编译后什么也没有,资源应用为0.这是怎么回事,谢特权释疑。
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