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SOPC的CPU与CFI控制器互联

2010-1-18 22:05 3697 0 3 分类: FPGA/CPLD

SOPCCPUCFI控制器互联


Altera SOPC Builder提供了众多的FLASH控制器IP核,除了一些通用型号外,还有一个可配置的通用FLASH控制器IP核,称之为CFIcommon flash interface controller core)。不得不承认,特权对SOPC的架构还是比较陌生的,还处于起点阶段,需要在不断的实战演练中加深认识和理解。对于这个CFI的配置也是花了一定时间才琢磨透。<?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" />


         如图1所示,添加CFI控制器。


<?xml:namespace prefix = v ns = "urn:schemas-microsoft-com:vml" />


91b80b79-c598-41c9-8f20-92a39badbccb.JPG


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         用户需要根据实际情况在弹出的配置窗口中进行CFI控制器的地址线宽、数据位宽以及一些相关建立保持时间等参数的设置。详细的说明和配置方法可以参考:Quartus II Handbook, Volume 5: Embedded Peripherals Section I-3


         配置完的CFI接口无法和CPU直接连接,如图2所示,无论是CPUinstruction_master还是data_master都和cfi_flash没有连接起来。



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         开始特权也很困惑,但是仔细翻找了资料才发现如图3所示,CPUCFI之间应该有一个桥逻辑进行连接。这个桥的作用也很显而易见,CPU的存储接口总线是有限的,那么通过桥逻辑进行译码控制,将其原先的较少的控制接口扩展为多路控制接口,而仍然可以复用一套地址和数据总线,从而达到系统互联并且互不干扰的效果。



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         因此特权在添加了一个Avalon-MM Tristate Bridge组件后,CFI自动和该桥组件相连,桥组件也会自动和CPU产生互联,从而连接起CPUCFI控制器。添加桥组件后的互联逻辑如图4所示。



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文章评论 3条评论)

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673167186_907543403 2015-3-19 14:38

老师您好,我看过您的《深入浅出玩转FPGA》,最近有个小问题困扰我了,是这样的,是一个算法的实现,具体的有图片,但是回帖没法附图,所以我发到这个博客里面了,您能帮我看看嘛,万分感谢,很小的一个问题但是困扰我很久 链接地址如下:http://bbs.ednchina.com/BLOG_ARTICLE_3028174.HTM

hanbin08041813 2010-12-27 17:49

特权哥哥 咱就不能用外部memory缓存一下吗??。。

ilove314_323192455 2010-7-28 12:31

也不是很清楚,得问问EDN

zhushigao01_138473626 2010-7-28 09:49

特权同学,这篇文章的图都不能打开的?
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