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Virtual JTAG仿真操作

2010-3-12 18:35 3161 0 2 分类: FPGA/CPLD

Virtual JTAG仿真操作


         Riple兄也曾就Virtual JTAG仿真写过博文《Virtual JTAG仿真要点》,文章中就VJI的仿真原理和基本操作概念做了详细的介绍。《Virtual JTAG Megafunction User Guide》中也有专门叙述。特权同学这里也不多阐述概念,和大家一起学习下实际仿真的操作步骤和方法。


1,准备:有一个建立好待调试的工程,添加VJI Megafunction,其中在图1Simution Stimuli中添加激励,具体含义查看前面列出的参考文章。该实例中依次添加写入IR值分别为0x1,0x2,0x3的激励,并在每次写IR后添加一个读DR激励。


<?xml:namespace prefix = v ns = "urn:schemas-microsoft-com:vml" /><?xml:namespace prefix = o ns = "urn:schemas-microsoft-com:office:office" />


点击看大图


1


2,无需在整个工程的仿真激励中做任何额外的工作,只要正常进行添加激励。并运行仿真,将例化的virtual_jtag下的tms\tck\tdi\tdo等信号添加到波形窗口进行观察。运行仿真如图2所示。



点击看大图


2


         可以看到ir_in寄存器依次出现0,1,2三个预定值。而tdo也在相应的读出过程中送出对应的0x11,0x22,0x33


         这个仿真是基于行为级或者功能级的,并且具有一些局限性,很多时候应该只是验证例化的这个VJI通路是否打通了。好在tck的频率并不高(10M),个人认为设计中应该处理好跨时钟域的问题,就是tckFPGA内部本身运行的系统时钟之间数据交换的问题。


 


 

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文章评论 2条评论)

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profee.zhang_892409436 2016-3-4 17:05

2016年3月4日已阅

346995926_737444981 2015-8-19 09:02

感觉有些概念化,所有的书都是这么说的,可是在现实生活中,哪种类型项目需要用FPGA做更有优势,有什么优势,这样或许可以让我们有更深的了解。。。

498216063_920143026 2015-4-16 10:19

写的好,学习和参考了

xudonghai203_645169024 2015-3-28 23:12

写的好,学习和参考了

xudonghai203_645169024 2015-3-28 23:12

写的好,学习和参考了

308352276_602752769 2010-11-29 11:20

我想问一下virtual jtag是上升沿收数据下降沿发数据还是上升沿发数据下降沿收数据

ash_riple_768180695 2010-3-13 07:15

Yes, the proper handling of Clock Domain Crossing issue must be added to any VJI instance.
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