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原创 Xilinx FPGA入门连载20:3-8译码器实验

2015-11-1 21:29 638 0 分类: FPGA/CPLD 文集: FPGA入门

Xilinx FPGA入门连载203-8译码器实验

特权同学,版权所有

配套例程和更多资料下载链接:

http://pan.baidu.com/s/1jGjAhEm

20151101212919172001.jpg

 

1 功能简介

         所有3-8译码器,大家可以baidubing一下。我们就不做太复杂的控制,对于我们这个实验,所有的接口如下。

            input ext_clk_25m, //外部输入25MHz时钟信号

            input ext_rst_n,   //外部输入复位信号,低电平有效

            input[3:0] switch, //4个拨码开关接口,ON -- 低电平;OFF -- 高电平。SW3为总开关;SW4SW5SW6的三个译码输入

            output reg[7:0] led    //8LED指示灯接口   

         相信玩咱们板子的童鞋,一定都上过数字电路的课程,所以咱也不多废话,给个真值表,一目了然。

SW3

SW6SW5SW4

复位

点亮LED

X

X,X,X

0

全灭

OFF

X,X,X

1

全灭

ON

OFF,OFF,OFF

1

D2点亮

ON

OFF,OFF,ON

1

D3点亮

ON

OFF,ON,OFF

1

D4点亮

ON

OFF,ON,ON

1

D5点亮

ON

ON,OFF,OFF

1

D6点亮

ON

ON,OFF,ON

1

D7点亮

ON

ON,ON,OFF

1

D8点亮

ON

ON,ON,ON

1

D9点亮

注:X表示ONOFF,即任意状态。

 

2 板级调试

         下载sp6.bit文件到FPGA中,可以如图视频一样操作拨码开关,实现3-8译码器的功能。

 

 

 

 

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