原创 【博客大赛】Xilinx FPGA入门连载43:FPGA 片内ROM实例之功能概述

2016-1-7 22:56 854 0 分类: FPGA/CPLD 文集: FPGA入门

Xilinx FPGA入门连载43FPGA片内ROM实例之功能概述

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http://pan.baidu.com/s/1jGjAhEm

20160105193157277001.jpg

 

1 功能概述

         该工程实例内部系统功能框图如图所示。我们通过IP核例化一个ROM,定时遍历读取其所有地址的数据。通过ISE集成的在线逻辑分析仪chipscope,我们可以观察ROM的读时序。

20160105193204295002.jpg

 

2 模块划分

         本实例工程模块层次如图所示。

20160105193210252003.jpg

  Pll_controller.v模块产生FPGA内部所需时钟信号。

  Rom_test.v模块例化FPGA片内ROM,并产生FPGA片内ROM读地址,定时遍历读取ROM中的数据。

  Chipscope_debug.cdc模块引出ROM的读取信号总线,通过chipscopeISE中在线查看ROM读取时序。

 

 

 

 

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