原创 Xilinx FPGA入门连载45:FPG**内ROM实例之功能仿真

2016-1-10 21:50 360 0 1 分类: FPGA/CPLD 文集: FPGA入门

Xilinx FPGA入门连载45FPGA片内ROM实例之功能仿真

特权同学,版权所有

配套例程和更多资料下载链接:

http://pan.baidu.com/s/1jGjAhEm

20160110214630112001.jpg

 

1 Xilinx库设置

         打开文件夹sp6ex17下的ISE工程。

如图所示,切换到“Design à Simulation”界面。鼠标选中“vtf_sp6.v”文件。

20160110214636879002.jpg

         此时,在“Processer:vtf_sp6”下,选择“Simulate Behavioral Model”,然后点击鼠标右键,弹出菜单中选择“Process Properties…”。

20160110214642721003.jpg

         如图所示,确认设置好在安装Modelsim过程中编译好的ISE Library路径。设定完成后点击“OK”回到ISE主界面。

20160110214649262004.jpg

 

2 功能仿真

         如图所示,双击“Simulate Behavioral Model”开始仿真。

20160110214655485005.jpg

         接着,Modelsim中我们可以查看读ROM的波形。

20160110214702797006.jpg

20160110214709790007.jpg

20160110214717566008.jpg

         这里需要注意,rom_addr出现新地址时,rom_data对应的数据要延时一个时钟周期才会出现。以最后一个图为例,当rom_addr = 0x01时,rom_data对应的数据时0x22,比地址出现晚一个时钟周期。

 

 

 

 

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文章评论 1条评论)

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294064077_281801863 2016-1-11 18:55

上学时,看特权老师的视频学altera;现在工作要用xilinx,再次跟随特权老师。真的很好的教程。
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