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原创 Xilinx FPGA入门连载60:FPGA 片内ROM FIFO RAM联合实例之功能仿真

2016-3-17 22:12 211 0 分类: FPGA/CPLD 文集: FPGA入门

Xilinx FPGA入门连载60FPGA 片内ROM FIFO RAM联合实例之功能仿真

特权同学,版权所有

配套例程和更多资料下载链接:

http://pan.baidu.com/s/1jGjAhEm

20160317220448273001.jpg

 

1 Xilinx库设置

         打开文件夹sp6ex21下的ISE工程。

如图所示,切换到“Design à Simulation”界面。鼠标选中“vtf_sp6.v”文件。

20160317220456293002.jpg

         此时,在“Processer:vtf_sp6”下,选择“Simulate Behavioral Model”,然后点击鼠标右键,弹出菜单中选择“Process Properties…”。

20160317220503604003.jpg

         如图所示,确认设置好在安装Modelsim过程中编译好的ISE Library路径。设定完成后点击“OK”回到ISE主界面。

20160317220511431004.jpg

 

2 功能仿真

         如图所示,双击“Simulate Behavioral Model”开始仿真。

20160317220518798005.jpg

         接着,Modelsim中我们可以查看读写ROMFIFORAM的波形。

         所有的读写波形:

20160317220525410006.jpg

         ROM读数据波形:

20160317220535977007.jpg

         FIFO第一次读波形:

20160317220547415008.jpg

         FIFO第二次读波形:

20160317220555362009.jpg

         FIFO第三次读波形:

20160317220604374010.jpg

         FIFO第四次读波形:

20160317220612540011.jpg

         RAM读波形:

20160317220619339012.jpg

 

 

 

 

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